看板 Tech_Job作者 Multilink (宇智波士頓派)標題 [請益] 碩班有下過晶片會差很多嗎時間 Mon Jan 3 01:17:58 2022
各位晚上好，
小弟目前大三，
也差不多要決定未來研究所的實驗室了，
因為不太了解業界的情況所以想來問問，
在研究所真的有下過一顆晶片的話，
未來找工作真的會差很多嗎？
謝謝
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推 C24128390: 類比差蠻多的 數位沒差 一堆一線designer只修過課1F 01/03 01:24
推 flysonics: 同樣起跑點的話 你有下過線的經驗基本上會加不少分2F 01/03 01:28
推 LLSGG: 沒下就可以畢業喔？真心爽6F 01/03 01:44
推 a810086: 沒有差 還不如早點了解業界在做什麼早點學7F 01/03 01:44
推 matrixon: 學店仔想混到文憑後到三流公司工作才會覺得沒差8F 01/03 02:58
推 po1379: 實驗室若有下晶片發paper的機會可以把握一下9F 01/03 05:06
噓 peter98: 紅明顯 認真回你 有下晶片的經驗確實有差 但是G8的是很多教授故意用下晶片讓你兩年沒辦法畢業10F 01/03 06:28
→ TsmcEE: 差hen多12F 01/03 06:35
→ nWave: 差很多，會晚一年畢業，少賺一年15F 01/03 07:11
推 GymRat: 沒差 現在理工有修課都能當DE16F 01/03 07:58
推 bluesox: 數位沒差，很多只跑FPGA也可以進ic公司，前提是要四大畢業17F 01/03 07:58
推 ptta: 如果所有的應徵者都沒下線過，那就沒差。你想可能嗎？21F 01/03 08:33
推 louiswu: 要下晶片的通常2.5+才能畢業23F 01/03 08:45
推 best1026: 有差，但不只要一顆，越多越好26F 01/03 09:16
推 qazxcvb: 修過iclab就可以了27F 01/03 09:19
推 GodIronman: 你是老闆相同的錢你會想請誰？這麼簡單的問題28F 01/03 09:27
→ dslite: 我碩論演算法 工作後被抓去寫verilog 事前沒學過
所以有沒有差看機運30F 01/03 10:22
推 ttokin: 類比沒下過跟紙上談兵差不多,以前是醬啦 但未來缺人就不知了32F 01/03 11:53
推 gn01216674: 類比沒下過的話，會被質疑是不是下了失敗不敢講XD34F 01/03 11:59
推 ctct0513: 做數位的學歷對了 有修過相關課程 就差不多一線了35F 01/03 12:30
推 gabriel: 以前老師都戲稱下線是把賓士開去撞牆36F 01/03 12:31
噓 dylan0215: 我認識連RTL寫都沒寫過,就到發哥了，應該是只要識字就好38F 01/03 14:23
推 wwwsky: 類比非常需要下線驗證 才知道模擬與量測數據 為何天差地遠？40F 01/03 14:49
→ AGM304: 在台灣類比碩班沒下過線，就一定是有問題啦42F 01/03 14:50
推 ayn775437403: 類比沒差 數位的根本沒幾間lab在下晶片了
*類比才有差 打錯45F 01/03 15:52
推 kouytw: 據說成果拿到是顆石頭的話就....49F 01/03 18:35
推 twsoriano: 有差，但只要找到夠力的學長可以內推可忽略50F 01/03 19:41
→ sc1: 有進過無塵室輪班最好 蝕刻 黃光51F 01/03 19:58
推 gragon: 沒差 進去在學52F 01/03 20:16
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